Application and reliability of Au-Sn electroplated layer on the CSP hermetical packaging
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摘要:
芯片级尺寸封装的气密性被越来越广泛的关注,为了实现CSP器件的可伐管帽与陶瓷基板之间的气密性互连,采用分层电镀沉积的方法在高温共烧陶瓷(HTCC)基板表面制备了金/锡/金镀层,利用金与锡间的共晶反应以实现管帽和基板的气密性可靠封接. 文中分析了金/锡/金镀层质量、焊接工艺对Au80Sn20共晶焊料封接结果的影响. 结果表明,金/锡/金镀层厚度和层间的结合力决定了Au-Sn共晶焊料的封接质量. 在焊接升温过程中,锡镀层首先熔化形成“熔池”,溶解上下侧与之接触的金镀层,直至完成共晶反应;采用较短的焊接时间能够实现更好的金锡共晶封接;焊接温度为330 ℃、保温时间为30 s时,Au-Sn镀层共晶反应形成δ/(Au,Ni)Sn—ζ相—δ/(Au,Ni)Sn的分层共晶组织,实现了可伐管帽与HTCC基板的气密性封接.
Abstract:Hermetical packaging in CSP component is increasingly investigated. In order to realize the hermetic interconnection between Kovar cap and ceramic substrate, the electroplating method was used and Au/Sn/Au sandwiched layers were fabricated on the HTCC substrate. Through the eutectic reaction between Au and Sn, a hermetic interconnection was realized. In this paper, the influence of Au/Sn/Au electroplated layer quality and soldering parameter on the packaging quality of Au-Sn eutectic solder was systematically investigated. It is found that the Au/Sn/Au electroplated layer thickness and interlayer bonding would directly determine the packaging results. During the soldering process, Sn electroplated layer firstly melted and a molten pool thus formed. The molten Sn then dissolved the surrounding Au electroplated layer and the Au-Sn eutectic reaction occurred. The shorter soldering time was better for the Au-Sn eutectic packaging. When the soldering temperature was 330 ℃ and holding time was set to 30 s, the (Au, Ni)Sn—ζ phase—(Au, Ni)Sn delaminated eutectic microstructures formed due to Au-Sn eutectic reaction and a reliable hermetical packaging between Kovar cap and HTCC substrate was eventually realized.
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Keywords:
- Au-Sn solder /
- eutectic reaction /
- electrodeposition /
- CSP hermetical packaging
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0. 序言
随着电子器件的可靠性要求越来越高,微小尺寸器件的气密性封装技术被越来越广泛的研究和应用[1-2]. 目前微小尺寸器件的封装形式主要采用芯片级尺寸封装(chip scale packaging, CSP)[3],在CSP器件的气密性封装结构中,使用高温共烧陶瓷作为载体或基板,而管帽则由金属材料制成,从而实现对内部芯片的有效保护[4]. Au-Sn共晶焊料由于具有优异的焊接性能和力学性能[5],成为CSP器件封装系统内实现金属管帽与陶瓷基板之间气密性可靠互连的首选材料[6].
Au80Sn20共晶钎料的熔点为278 ℃,钎焊温度达到了300 ~ 310 ℃,可以替代熔点在280 ~ 360 ℃内的高熔点铅基合金钎料,并且能够承受较高的处理温度,保证良好的耐腐蚀性和抗蠕变性. Au80Sn20共晶合金由两种金属间化合物ζ相和δ/AuSn相组成,具有较大脆性,用常规的方法难以加工成形[7]. 常用的制备技术有预成形片法[8]、丝网印刷法[9]、蒸发/溅射沉积法[10]和电镀沉积法[11-12]等.
预成形焊片法采用熔铸增韧工艺、叠层冷轧工艺或机械合金化工艺制备Au-Sn共晶焊料,但是合金成形困难,加工过程易氧化;丝网印刷法是将焊膏印刷在封装焊盘的金属化层上,通过回流熔融形成Au-Sn共晶合金,这种方法对印刷质量要求较高,回流时易形成空洞;蒸发/溅射沉积法通过分层沉积不同厚度的金层与锡层(或Au-Sn混合层),这种方法需要使用真空系统,存在设备昂贵、加工周期长、材料利用率低等问题,不适合大规模生产;电镀沉积法利用电化学方法将Au和Sn离子在基体表面实现沉积, 可以精确控制镀层的厚度及图形,具有设备简单、成本低廉、工艺成熟、易于大规模生产等优势.
采用电镀沉积法在陶瓷基板上制作了金锡镀层,并对镀层质量进行了表征分析,通过熔封曲线的调控实现了CSP器件的气密性封装,对金锡焊料的工程应用、工艺优化及封装结构可靠性具有重要意义.
1. 试验方法
与其它方法相比,金锡分层电镀沉积法可控性强,能够精确控制Au和Sn元素成分比例,因此采用电镀沉积方法在高温共烧陶瓷(HTCC)基板上制备了金属层,层结构如图1所示,其中W层作为陶瓷基板上的黏附层,Ni-Co则起到了扩散阻挡层和浸润层的作用. 通过分层电镀沉积不同厚度的金层与锡层,组成Au80Sn20(质量分数,%)共晶钎料,为了实现该比例,控制金层和锡层的厚度比为1.5∶1. 金/锡/金共晶焊料层总厚度设计为12 μm,另外Au元素和Ni元素之间无限互溶,进一步加强了镀层之间的浸润,表层的金则起到了抗氧化的作用.
为了评估金/锡/金镀层质量对互连界面的影响,分别选取两种镀层的基板进行金相表征和显微组织分析,显微组织分析采用FEI公司的环境扫描电子显微镜(scanning electron microscopy, SEM, Quanta 200),并利用其附带的EDAX能谱仪进行界面显微元素分析.
为了研究Au-Sn合金镀层质量对熔封效果的影响,将电镀后的高温共烧陶瓷基板置于320 ℃加热台回流30 s,对金/锡/金镀层的表面状态和横截面进行观察,确认Au-Sn镀层质量. 此处CSP器件封装管帽采用可伐合金材料冲压而成,其与基板的熔封在真空回流炉中实现,先抽真空,后充入高纯氮气,以使炉腔均匀快速升温,封装回流曲线如图2所示. 焊接工艺设置了预热阶段,预热至120 ℃并保持60 s,然后继续升温至310 ℃,保温90 s后空冷至室温.
回流完成后,对管帽与陶瓷基板的互连界面进行显微组织分析,同时对封装好的器件进行加压检漏和热循环试验,试验条件为−55 ~ 85 ℃. 采用SEM表征热循环之后互连界面的微观组织变化,进而评估金和锡镀层对管帽封装热循环可靠性影响.
2. 试验结果
2.1 陶瓷基板金属镀层的显微组织
图3为电镀完成后陶瓷基板表面的金属镀层显微形貌. 图3a为镀层质量差的陶瓷基板表面,由图可以看出,金/锡/金镀层质量差主要体现为①两侧金镀层厚度差距大,上侧金镀层较薄,仅有~ 2 μm,而下侧金镀层较厚,厚度为 ~ 6 μm;②下侧金层出现了孔洞,而且孔洞出现在金层和锡层之间,这说明金/锡/金镀层的层间结合力差. 与之相比,图3b显示的陶瓷基板上侧金/锡/金镀层的质量优良,两侧金镀层厚度差较小,上侧金镀层约为~ 3 μm,下侧金镀层厚度约为 ~ 4 μm,而且镀层的界面处未发现孔洞.
2.2 陶瓷基板金属镀层熔融后的显微组织
为了研究镀层质量对金/锡/金熔封过程的影响,进而阐明陶瓷基板上金属镀层的互连冶金过程,采用320 ℃加热台对陶瓷基板首先进行熔融处理. 图4为熔融完成后两种陶瓷基板表面的金相显微形貌,由图4a可知,金/锡/金镀层质量差的基板镀层熔融后,表面质量差,局部区域出现凹陷不平状,并伴有灰褐色斑块浮现. 与之相比,金/锡/金镀层质量优良的基板的镀层熔融后,表面光亮饱满,富有金属光泽,并未看到凹陷. 在局部区域甚至可以看到Au-Sn的共晶组织,如图4b所示,因此金/锡/金电镀层的质量对陶瓷基板熔融后的形貌与组织产生显著的影响.
为了深入分析金/锡/金电镀层的熔融过程,对熔融后陶瓷基板上侧的横截面组织进行了SEM表征,结果如图5所示. 可以看出,质量差的金/锡/金电镀层熔融之后,上侧的Au-Sn共晶层变得很薄,仅有 ~ 4 μm,这对应了图4a中陶瓷基板表面的凹陷部分. 与之相比,质量优良的金/锡/金电镀层熔融之后,形成了良好的Au-Sn共晶组织,如图5b所示,共晶层整体厚度均匀,与熔融前金/锡/金镀层厚度一致,约为11 μm(图3b).
考虑到金/锡/金电镀层熔融是一个连续升温的过程,而Au-Sn发生共晶反应的温度是278 ℃,因此在温度上升至320 ℃的过程中,中间的锡镀层会首先发生熔化,形成一个“熔池”;熔化的锡会溶解金层,形成Au-Sn化合物,但是当流动的锡熔体遇到镀层界面的孔洞时,没有金溶解,这就导致锡熔体流动到基板的其它地方,造成该处镀层变薄,凝固后出现凹陷.
以上分析进一步说明,与传统Au-Sn共晶焊不同,此处使用分层电镀方法制备的金/锡/金镀层并没有直接生成Au-Sn共晶组织,而是在升温过程中首先熔化的锡镀层溶解固态的金镀层,形成Au-Sn间化合物;当温度高于共晶温度278 ℃时,金/锡/金镀层才会迅速液化,发生共晶反应;随后冷却过程中,由液相中生成ζ相和δ相AuSn,ζ相和δ相以层片状排列,构成共晶组织,如图5b所示. 表1是图5b中共晶层的两相的能谱分析结果,由此可知,图5b中浅色的组织是ζ相,深色的组织是δ相(AuSn). 对比图5a和图5b可知,质量较差的金/锡/金镀层经历熔融和凝固之后,虽然生成了浅色的ζ相和深色的δ相,但其并没有形成层片状共晶组织,这说明金/锡/金镀层的质量直接影响熔封之后AuSn共晶组织的形态,进而影响陶瓷基板与金属管帽之间的互连结果与可靠性.
表 1 图5b中Au-Sn化合物的成分(原子分数,%)Table 1. Au-Sn intermetallic compounds in Fig. 5b位置 Au Sn Ni Co W 化合物 1 85. 64 14. 36 0 0 0 ζ 2 57. 88 42. 12 0 0 0 δ/AuSn 2.3 管帽与陶瓷基板封接后的界面组织分析
CSP封装结构的微腔保护了芯片的工作区域不受外界湿气和电磁的干扰 ,因此封装结构中管帽和陶瓷基板的互连可靠性关系到封装器件是否可以正常工作. 图6a是CSP器件封装结构的剖面图,冲压制作的可伐合金管帽与电镀后的HTCC基板上的Au-Sn焊料环熔封焊接,封装回流曲线如图2所示,采用缓慢升温的方式进行器件熔封,焊接峰值温度为310 ℃,保温90 s.图6b是管帽与陶瓷基板互连处的SEM表征与相应的界面各元素分布的能谱面扫描结果. 陶瓷基板上制备了质量优良的金/锡/金镀层(图3b),将可伐合金管帽与基板压在一起,然后升温实现连接. 表2是与图6b对应的界面Au-Sn共晶层的相组成分析结果. 根据界面的SEM形貌(图6b)和相分析(表2)可知,可伐管帽和HTCC基板之间形成了良好的连接,在Au-Sn共晶焊料层内生成了ζ相和δ/(Au,Ni)Sn相,其中(Au,Ni)Sn相主要分布在两侧,中间则是ζ相和富Sn相.
表 2 图6b中Au-Sn共晶层相成分(质量分数,%)Table 2. Au-Sn intermetallic compounds in Fig. 6b位置 Au Sn Ni Co Fe 化合物 1 48.1 40.9 9.2 0.8 1.9 (Au,Ni)Sn 2 60.6 33.4 4.6 0.9 0.5 富锡相 3 85.5 10.5 2.4 0.8 0.5 ζ 4 85.9 10.8 2.3 0.4 0.6 ζ 5 52.1 38.6 7.4 1.5 0.4 (Au,Ni)Sn 根据2. 2节的分析,当温度升高时,中间的锡镀层首先发生熔化,由中间向两侧溶解金层;温度升高至Au-Sn共晶点以上,Au-Sn之间发生共晶反应,金/锡/金镀层快速液化,进而溶解可伐合金镍层,形成ζ相和δ/AuSn相,其中由于金和镍是无限互溶的,镍会进入Au-Sn相的晶格内,形成(Au, Ni)Sn界面金属间化合物,实现可伐合金引脚与陶瓷基板的互连.
为探究不同封装回流曲线对Au-Sn共晶焊料封接效果的影响,将预热温度和峰值温度分别提高至220和330 ℃,同时提高了升温速率,但是将在峰值温度的保温时间缩短至30 s,改进后封装回流曲线如图7所示.
图8是采用图7所示的曲线获得的管帽-基板互连界面的微观组织形貌和面能谱分析. 改变封装回流曲线之后,可伐管帽与HTCC基板之间也获得了良好的互连;但采用图7所示的曲线,共晶焊料层的组织形态发生了变化,即共晶焊料层内出现了明显的分层,中间没有锡剩余. 结合表3所示的相成分分析,此时共晶焊料层由δ/(Au,Ni)Sn—ζ相—δ/(Au,Ni)Sn夹层结构组成.
表 3 图8中Au-Sn共晶层相成分(原子分数,%)Table 3. Au-Sn intermetallic compounds in Fig. 8b位置 Au Sn Ni Co Fe 化合物 1 48.0 40.2 10.0 0.6 1.1 (Au,Ni)Sn 2 87.6 10.6 1.3 0 0.5 ζ 3 84.5 12.8 1.9 0.5 0.3 ζ 4 87.3 10.6 1.3 0.5 0.3 ζ 5 49.1 38.9 8.5 3.2 0.3 (Au,Ni)Sn 6 49.9 38.7 7.9 3.1 0.4 (Au,Ni)Sn 对比两种曲线获得的互连界面组织,可以发现,当焊接峰值温度为310 ℃时(图2),金和锡之间反应并不完全,导致中间锡层仍有锡残余;当焊接峰值温度为330 ℃时(图7),虽然保温时间由90 s缩短至30 s,中间锡层已经全部转变成了Au-Sn化合物ζ相,说明此时金和锡之间反应完全. 根据前述管帽封接过程中金/锡/金镀层共晶冶金机理,Au-Sn共晶反应需要快速完成,避免升温过程中熔融锡过多消耗. 采用图2所示曲线时,由于升温速率慢,熔融的锡在溶解金形成富锡金属间化合物的同时,其熔池界面处的熔点也在升高,导致其溶解金能力下降,结果中间锡层没有反应完全,仍有大量的锡残留. 因此相对于保温时间,峰值温度对Au-Sn熔封的结果影响更大,采用快速升温方法达到更高的焊接温度所产生的熔封效果更好.
两种曲线获得的管帽-基板界面均出现了δ/(Au,Ni)Sn相偏聚在可伐管帽引脚一侧,这与图5b所示的陶瓷基板直接熔融之后形成的层片状共晶组织不同,其原因是管帽引脚镍层部分溶解进入δ/AuSn相所致,表明金锡共晶焊料与可伐管帽实现了有效焊接.
2.4 互连界面的热循环可靠性分析
对采用图7焊接曲线封装的管帽-基板进行检漏试验,试验条件如表4所示,检漏结果为合格.
表 4 密封检漏试验条件Table 4. Test conditions of leakage detection粗检漏 细检漏 按照GJB548B—2005方法1014. 2中C1规定进行试验,要求是器件粗检时应无同一位置出来的一串明显气泡或两个以上大气泡 按照GJB548B—2005方法1014. 2中A1规定进行试验,要求是器件细检漏率不大于5 × 10−3(Pa·cm3)/s 剪切力是衡量金锡焊料封接质量的另一项重要指标. 将器件固定在推力测试台上,平行于基板方向施加推力进行剪切力测试,测得管帽脱离推力分布在6 500 ~ 7 500 g,根据管帽封接环尺寸计算,其抗剪强度分布在41. 88 ~ 48. 32 MPa. 如图9所示,管帽推落端口焊缝规则完整,基板表面粘附层有拉扯脱落,表明金锡共晶封接质量较好.
对封装后的管帽-基板进行−55 ~ 85 ℃的热循环测试,试验按照GJB 548B—2005中方法1010. 1和下述规定进行,如表5所示. 在温度循环测试完成后,对封装的器件进行机械冲击测试,测试条件按照GJB 548B—2005中方法2002,即冲击力1 500 g,冲击方向为y1方向,冲击10次. 对经历温度循环和冲击测试后的器件,再次进行检漏,检漏结果器件合格,对其进行剪切力测试,抗剪强度保持在40 MPa以上,与试验前无明显改变. 图10是300次循环后界面的显微组织与元素分布.
表 5 温度循环试验条件Table 5. Test conditions of temperature cycle试验温度T/℃ 每步停留时间t1/min 冷热转换时间t2/min 循环次数N(次) −55 ~ 85 15 ≤1 100 表6是图10中Au-Sn互连层内的相分析结果. 由图10和表6可知,经历300次循环之后,互连界面的形态和组织并没有发生明显变化,Au-Sn互连层保持δ/(Au,Ni)Sn—ζ相—δ/(Au,Ni)Sn分层结构,在界面上并没有观察到疲劳裂纹,这表明采用金/锡/金电镀层,通过Au-Sn共晶反应实现CSP器件的金属管帽与陶瓷基板之间的封接是稳定可靠的.
表 6 图10中Au-Sn共晶层相成分(质量分数,%)Table 6. Au-Sn intermetallic compounds in Fig. 10位置 Au Sn Ni Co Fe 化合物 1 41.8 40.8 15.7 0.8 1.0 (Au,Ni)Sn 2 88.3 8.6 1.6 0.9 0.6 ζ 3 89.0 9.0 1.4 0.2 0.4 ζ 4 88.9 8.9 1.5 0.4 0.3 ζ 5 48.4 39.5 8.9 2.8 0.3 (Au,Ni)Sn 3. 结论
(1)分层电镀沉积法制备的金/锡/金镀层的质量,尤其是层厚度和层间的结合力,将会严重影响Au-Sn共晶焊料的封接质量.
(2)在焊接时,锡镀层首先熔化形成“熔池”,溶解上下两侧的金镀层,直至完成共晶反应生成δ/(Au,Ni)Sn—ζ相—δ/(Au,Ni)Sn分层组织结构.
(3)相比于保温时间,焊接温度对Au-Sn共晶焊料的封接结果影响更大,为了形成Au-Sn共晶组织,需要优化调整封装回流曲线.
(4)在HTCC基板上分层电镀金/锡/金,焊接温度在330 ℃,时间维持30 s时,Au-Sn共晶反应完全,实现可伐管帽与HTCC基板的可靠密封,该工艺稳定可靠,适合于批量化生产.
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表 1 图5b中Au-Sn化合物的成分(原子分数,%)
Table 1 Au-Sn intermetallic compounds in Fig. 5b
位置 Au Sn Ni Co W 化合物 1 85. 64 14. 36 0 0 0 ζ 2 57. 88 42. 12 0 0 0 δ/AuSn 表 2 图6b中Au-Sn共晶层相成分(质量分数,%)
Table 2 Au-Sn intermetallic compounds in Fig. 6b
位置 Au Sn Ni Co Fe 化合物 1 48.1 40.9 9.2 0.8 1.9 (Au,Ni)Sn 2 60.6 33.4 4.6 0.9 0.5 富锡相 3 85.5 10.5 2.4 0.8 0.5 ζ 4 85.9 10.8 2.3 0.4 0.6 ζ 5 52.1 38.6 7.4 1.5 0.4 (Au,Ni)Sn 表 3 图8中Au-Sn共晶层相成分(原子分数,%)
Table 3 Au-Sn intermetallic compounds in Fig. 8b
位置 Au Sn Ni Co Fe 化合物 1 48.0 40.2 10.0 0.6 1.1 (Au,Ni)Sn 2 87.6 10.6 1.3 0 0.5 ζ 3 84.5 12.8 1.9 0.5 0.3 ζ 4 87.3 10.6 1.3 0.5 0.3 ζ 5 49.1 38.9 8.5 3.2 0.3 (Au,Ni)Sn 6 49.9 38.7 7.9 3.1 0.4 (Au,Ni)Sn 表 4 密封检漏试验条件
Table 4 Test conditions of leakage detection
粗检漏 细检漏 按照GJB548B—2005方法1014. 2中C1规定进行试验,要求是器件粗检时应无同一位置出来的一串明显气泡或两个以上大气泡 按照GJB548B—2005方法1014. 2中A1规定进行试验,要求是器件细检漏率不大于5 × 10−3(Pa·cm3)/s 表 5 温度循环试验条件
Table 5 Test conditions of temperature cycle
试验温度T/℃ 每步停留时间t1/min 冷热转换时间t2/min 循环次数N(次) −55 ~ 85 15 ≤1 100 表 6 图10中Au-Sn共晶层相成分(质量分数,%)
Table 6 Au-Sn intermetallic compounds in Fig. 10
位置 Au Sn Ni Co Fe 化合物 1 41.8 40.8 15.7 0.8 1.0 (Au,Ni)Sn 2 88.3 8.6 1.6 0.9 0.6 ζ 3 89.0 9.0 1.4 0.2 0.4 ζ 4 88.9 8.9 1.5 0.4 0.3 ζ 5 48.4 39.5 8.9 2.8 0.3 (Au,Ni)Sn -
[1] 米佳, 李辉. 声表面波器件小型化技术发展概述[J]. 压电与声光, 2012, 34(1): 4 − 6. doi: 10.3969/j.issn.1004-2474.2012.01.002 Mi Jia, Li Hui. Overview of the development of SAW miniaturization technology[J]. Piczoclcctrics and Acoustooptics, 2012, 34(1): 4 − 6. doi: 10.3969/j.issn.1004-2474.2012.01.002
[2] Szostak K M, Keshavarz M, Constandinou T G. Hermetic chip-scale packaging using Au:Sn eutectic bonding for implantable devices[J]. Journal of Micromechanics and Microengineering, 2021, 31(9): 095003. doi: 10.1088/1361-6439/ac12a1
[3] Arriola E R, Unando A T, GonZaga J A, et al. Wafer-lever chip-scale package lead-free solder fatigue: A critical review [J]. Engineering Failure Analysis, 2022, 144: 106986.
[4] Huang Wei, Chen Zhiwen. Review on failure analysis of interconnections in power devices[J]. China Welding, 2022, 31(1): 6 − 14.
[5] Peng Jian, Liu Huashan, Fu Liming, et al. Multi-principal-element products enhancing Au–Sn-bonded joints[J]. Journal of Alloys and Compounds, 2021, 852: 157015. doi: 10.1016/j.jallcom.2020.157015
[6] 杨东升, 张贺, 冯佳运, 等. 电子封装微纳连接技术及失效行为研究进展[J]. 焊接学报, 2022, 43(11): 126 − 136. doi: 10.12073/j.hjxb.20220702003 Yang Dongsheng, Zhang He, Feng Jiayun, et al. Research progress on micro/nano joining technologies and failure behaviors in electronic packaging[J]. Transactions of the China Welding Institution, 2022, 43(11): 126 − 136. doi: 10.12073/j.hjxb.20220702003
[7] 刘文胜, 黄宇峰, 马运柱. Au80Sn20合金焊料的制备及应用研究进展[J]. 材料导报A, 2013, 27(6): 1 − 6. Liu Wensheng, Huang Yufeng, Ma Yunzhu. Research progress in preparation and application of Au80Sn20 solder alloy[J]. Materials Reports A, 2013, 27(6): 1 − 6.
[8] 熊杰然. 光电子封装用金锡焊片的制备[D]. 武汉: 华中科技大学, 2008. Xiong Jieran. Manufacture of gold-tin solder foil used in optoelectronic package[D]. Wuhan: Huazhong University of Science and Technology, 2008.
[9] Manessis D, Patzelt R, Ostmann A, et al. Technical challenges of stencil printing technology for ultra fine pitch flip chip bumping[J]. Microelectronics Reliability, 2004, 44(5): 797 − 803. doi: 10.1016/S0026-2714(03)00361-5
[10] 叶惠婕. 金锡共晶薄膜焊点的微观组织与力学性能[D]. 武汉: 华中科技大学, 2020. Ye Huijie. Study on microstructure and mechanical properties of AuSn20 film soldering joints [D]. Wuhan: Huazhong University of Science and Technology, 2020.
[11] Vokobyova T N, Vkublevskaya O N. Electrochemical deposition of gold-tin alloy from ethylene glycol electrolyte[J]. Surface & Coatings Technology, 2010, 204(8): 1314 − 1318.
[12] 方超. 无氰电镀金锡共晶合金及性能研究[D]. 大连: 大连理工大学, 2022. Fang Chao. Preparation of gold-tin eutectic alloy by cyanide-free electroplating and properties study [D]. Dalian: Dalian University of Technology, 2022.
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1. 李亚飞,张伟,陈华志,陈彦光,唐盘良,马晋毅. 一体式射频组件焊接工艺. 电子工艺技术. 2025(03): 24-28 . 百度学术
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